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// SPDX-License-Identifier: GPL-2.0-or-later
#include <common.h>
#include <init.h>
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#include <mach/omap4-silicon.h>
#include <mach/omap4-mux.h>
#include <mach/omap4-clock.h>
#include "mux.h"
static const struct pad_conf_entry core_padconf_array[] = {
{ GPMC_AD0 , IEN | PTU | M1 },
{ GPMC_AD1 , IEN | PTU | M1 },
{ GPMC_AD2 , IEN | PTU | M1 },
{ GPMC_AD3 , IEN | PTU | M1 },
{ GPMC_AD4 , IEN | PTU | M1 },
{ GPMC_AD5 , IEN | PTU | M1 },
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{ GPMC_A21 , IEN | PTD | M7 },
{ GPMC_A22 , IEN | PTD | M1 },
{ GPMC_A23 , IEN | PTD | M1 },
{ GPMC_A24 , IEN | PTD | M3 },
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{ GPMC_NCS0 , IEN | PTU | M0 },
{ GPMC_NCS1 , IEN | PTU | M7 },
{ GPMC_NCS2 , IEN | PTU | M7 },
{ GPMC_NCS3 , IEN | PTU | M3 },
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{ GPMC_NCS5 , IEN | PTD | M7 },
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{ GPIO63 , M0 },
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{ CSI21_DX4 , IEN | PTD | M7 },
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{ CAM_SHUTTER , PTD | M0 },
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{ SDMMC1_DAT4 , IEN | PTU | M0 },
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{ SDMMC1_DAT6 , IEN | PTU | M0 },
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{ ABE_MCBSP2_CLKX , IEN | M0 },
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{ ABE_MCBSP1_CLKX , IEN | PTD | M7 },
{ ABE_MCBSP1_DR , IEN | PTD | M7 },
{ ABE_MCBSP1_DX , M0 },
{ ABE_MCBSP1_FSX , IEN | M0 },
{ ABE_PDM_UL_DATA , IEN | PTD | M7 },
{ ABE_PDM_DL_DATA , IEN | PTD | M7 },
{ ABE_PDM_FRAME , IEN | PTD | M7 },
{ ABE_PDM_LB_CLK , IEN | PTD | M7 },
{ ABE_CLKS , IEN | PTD | M7 },
{ ABE_DMIC_CLK1 , IEN | PTD | M7 },
{ ABE_DMIC_DIN1 , IEN | PTD | M7 },
{ ABE_DMIC_DIN2 , IEN | PTD | M3 },
{ ABE_DMIC_DIN3 , IEN | PTD | M3 },
{ UART2_CTS , IEN | PTU | M0 },
{ UART2_RTS , M0 },
{ UART2_RX , IEN | M0 },
{ UART2_TX , M0 },
{ HDQ_SIO , IEN | M7 },
{ I2C1_SCL , IEN | M0 },
{ I2C1_SDA , IEN | M0 },
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{ I2C2_SDA , IEN | M0 },
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{ I2C3_SDA , IEN | M0 },
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{ I2C4_SDA , IEN | M0 },
{ MCSPI1_CLK , IEN | M0 },
{ MCSPI1_SOMI , IEN | M0 },
{ MCSPI1_SIMO , IEN | M0 },
{ MCSPI1_CS0 , IEN | PTD | M0 },
{ MCSPI1_CS1 , IEN | PTU | M1 },
{ MCSPI1_CS2 , M3 },
{ MCSPI1_CS3 , IEN | PTU | M7 },
{ UART3_CTS_RCTX , M1 },
{ UART3_RTS_SD , M0 },
{ UART3_RX_IRRX , IEN | PTU | M3 },
{ UART3_TX_IRTX , M0 },
{ SDMMC5_CLK , PTU | M0 },
{ SDMMC5_CMD , IEN | PTU | M0 },
{ SDMMC5_DAT0 , IEN | PTU | M0 },
{ SDMMC5_DAT1 , IEN | PTU | M0 },
{ SDMMC5_DAT2 , IEN | PTU | M0 },
{ SDMMC5_DAT3 , IEN | PTU | M0 },
{ MCSPI4_CLK , IEN | M0 },
{ MCSPI4_SIMO , IEN | M0 },
{ MCSPI4_SOMI , IEN | M0 },
{ MCSPI4_CS0 , IEN | PTD | M0 },
{ UART4_RX , IEN | M0 },
{ UART4_TX , M0 },
{ USBB2_ULPITLL_CLK , M3 },
{ USBB2_ULPITLL_STP , M5 },
{ USBB2_ULPITLL_DIR , M5 },
{ USBB2_ULPITLL_NXT , M5 },
{ USBB2_ULPITLL_DAT0 , M5 },
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{ USBB2_ULPITLL_DAT2 , M5 },
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{ USBB2_HSIC_DATA , M3 },
{ USBB2_HSIC_STROBE , M3 },
{ KPD_COL3 , IEN | PTD | M1 },
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{ KPD_COL5 , IEN | PTD | M1 },
{ KPD_COL0 , IEN | PTD | M1 },
{ KPD_COL1 , IEN | PTD | M3 },
{ KPD_COL2 , IEN | PTD | M3 },
{ KPD_ROW3 , IEN | PTD | M1 },
{ KPD_ROW4 , IEN | PTD | M1 },
{ KPD_ROW5 , IEN | PTD | M1 },
{ KPD_ROW0 , IEN | PTD | M1 },
{ KPD_ROW1 , IEN | PTD | M1 },
{ KPD_ROW2 , IEN | PTD | M1 },
{ USBA0_OTG_CE , PTU | M0 },
{ USBA0_OTG_DP , M0 },
{ USBA0_OTG_DM , M0 },
{ FREF_CLK1_OUT , IEN | PTD | M7 },
{ FREF_CLK2_OUT , IEN | PTD | M7 },
{ SYS_NIRQ1 , IEN | PTU | M0 },
{ SYS_NIRQ2 , IEN | PTU | M0 },
{ SYS_BOOT0 , IEN | PTD | M0 },
{ SYS_BOOT1 , IEN | PTD | M0 },
{ SYS_BOOT2 , IEN | PTD | M0 },
{ SYS_BOOT3 , IEN | PTD | M0 },
{ SYS_BOOT4 , IEN | PTD | M0 },
{ SYS_BOOT5 , IEN | PTD | M0 },
{ DPM_EMU0 , IEN | PTU | M0 },
{ DPM_EMU1 , IEN | PTU | M3 },
{ DPM_EMU2 , IEN | PTD | M7 },
{ DPM_EMU3 , M5 },
{ DPM_EMU4 , M5 },
{ DPM_EMU5 , M5 },
{ DPM_EMU6 , M5 },
{ DPM_EMU7 , M5 },
{ DPM_EMU8 , M5 },
{ DPM_EMU9 , M5 },
{ DPM_EMU10 , M5 },
{ DPM_EMU11 , M5 },
{ DPM_EMU12 , M5 },
{ DPM_EMU13 , M5 },
{ DPM_EMU14 , M5 },
{ DPM_EMU15 , M5 },
{ DPM_EMU16 , M5 },
{ DPM_EMU17 , M5 },
{ DPM_EMU18 , M5 },
{ DPM_EMU19 , M5 },
{ CSI22_DX2 , IEN | PTD | M7 },
{ CSI22_DY2 , IEN | PTD | M7 },
};
static const struct pad_conf_entry wkup_padconf_array[] = {
{ GPIO_WK0 , IEN | PTD | M7 },
{ GPIO_WK1 , IEN | PTD | M7 },
{ GPIO_WK2 , IEN | PTD | M7 },
{ GPIO_WK3 , IEN | PTU | M7 },
{ GPIO_WK4 , IEN | PTD | M7 },
{ SR_SCL , IEN | M0 },
{ SR_SDA , IEN | M0 },
{ FREF_XTAL_IN , M0 },
{ FREF_SLICER_IN , M0 },
{ FREF_CLK_IOREQ , IEN | PTD | M0 },
{ FREF_CLK0_OUT , IEN | PTD | M7 },
{ FREF_CLK3_REQ , IEN | PTD | M7 },
{ FREF_CLK3_OUT , IEN | PTD | M7 },
{ FREF_CLK4_REQ , IEN | PTU | M3 },
{ FREF_CLK4_OUT , IEN | PTD | M0 },
{ SYS_32K , IEN | M0 },
{ SYS_NRESPWRON , M0 },
{ SYS_NRESWARM , M0 },
{ SYS_PWR_REQ , IEN | PTU | M0 },
{ SYS_PWRON_RESET_OUT , IEN | PTD | M0 },
{ SYS_BOOT6 , IEN | M0 },
{ SYS_BOOT7 , IEN | M0 },
{ JTAG_NTRST , IEN | PTD | M0 },
{ JTAG_TCK , IEN | PTD | M0 },
{ JTAG_RTCK , PTD | M0 },
{ JTAG_TMS_TMSC , IEN | M0 },
{ JTAG_TDI , IEN | PTU | M0 },
{ JTAG_TDO , IEN | PTU | M0 },
};
void archosg9_set_muxconf_regs(void)
{
omap4_do_set_mux(OMAP44XX_CONTROL_PADCONF_CORE,
core_padconf_array, ARRAY_SIZE(core_padconf_array));
omap4_do_set_mux(OMAP44XX_CONTROL_PADCONF_WKUP,
wkup_padconf_array, ARRAY_SIZE(wkup_padconf_array));
/* gpio_wk7 is used for controlling TPS on 4460 */
if (omap4_revision() >= OMAP4460_ES1_0) {
/* Enable GPIO-1 clocks before TPS initialization */
omap4_enable_gpio1_wup_clocks();
}
}
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